Add SDIO GPIO initialization
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ad761213f2
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41bf4a4c5e
@ -456,6 +456,19 @@
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#define GPIO_CFIDE_NCE41 (GPIO_ALT|GPIO_CNF_AFPP|GPIO_MODE_50MHz|GPIO_PORTG|GPIO_PIN10)
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#define GPIO_CFIDE_NCE42 (GPIO_ALT|GPIO_CNF_AFPP|GPIO_MODE_50MHz|GPIO_PORTG|GPIO_PIN11)
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/* SDIO */
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#define GPIO_SDIO_D0 (GPIO_ALT|GPIO_CNF_AFPP|GPIO_MODE_50MHz|GPIO_PORTC|GPIO_PIN8)
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#define GPIO_SDIO_D1 (GPIO_ALT|GPIO_CNF_AFPP|GPIO_MODE_50MHz|GPIO_PORTC|GPIO_PIN9)
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#define GPIO_SDIO_D2 (GPIO_ALT|GPIO_CNF_AFPP|GPIO_MODE_50MHz|GPIO_PORTC|GPIO_PIN10)
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#define GPIO_SDIO_D3 (GPIO_ALT|GPIO_CNF_AFPP|GPIO_MODE_50MHz|GPIO_PORTC|GPIO_PIN11)
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#define GPIO_SDIO_D4 (GPIO_ALT|GPIO_CNF_AFPP|GPIO_MODE_50MHz|GPIO_PORTB|GPIO_PIN8)
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#define GPIO_SDIO_D5 (GPIO_ALT|GPIO_CNF_AFPP|GPIO_MODE_50MHz|GPIO_PORTB|GPIO_PIN9)
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#define GPIO_SDIO_D6 (GPIO_ALT|GPIO_CNF_AFPP|GPIO_MODE_50MHz|GPIO_PORTC|GPIO_PIN6)
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#define GPIO_SDIO_D7 (GPIO_ALT|GPIO_CNF_AFPP|GPIO_MODE_50MHz|GPIO_PORTC|GPIO_PIN7)
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#define GPIO_SDIO_CK (GPIO_ALT|GPIO_CNF_AFPP|GPIO_MODE_50MHz|GPIO_PORTC|GPIO_PIN12)
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#define GPIO_SDIO_CMD (GPIO_ALT|GPIO_CNF_AFPP|GPIO_MODE_50MHz|GPIO_PORTD|GPIO_PIN2)
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/* FSMC: NOR/PSRAM/SRAM (NPS) */
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#define GPIO_NPS_A0 (GPIO_ALT|GPIO_CNF_AFPP|GPIO_MODE_50MHz|GPIO_PORTF|GPIO_PIN0)
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@ -51,10 +51,19 @@
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#include "stm32_internal.h"
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#include "stm32_sdio.h"
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#if CONFIG_STM32_SDIO
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/****************************************************************************
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* Pre-Processor Definitions
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****************************************************************************/
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/* Configuration ************************************************************/
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#if defined(CONFIG_SDIO_DMA) && !defined(CONFIG_STM32_DMA2)
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# warning "CONFIG_SDIO_DMA support requires CONFIG_STM32_DMA2"
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# undef CONFIG_SDIO_DMA
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#endif
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/* Friendly CLKCR bit re-definitions ****************************************/
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#define SDIO_CLKCR_RISINGEDGE (0)
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@ -1049,6 +1058,22 @@ static void stm32_default(void)
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int mmcsd_slotinitialize(int minor, int slotno, FAR struct sdio_dev_s *dev)
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{
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/* Configure GPIOs for 4-bit, wide-bus operation (the chip is capable of
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* 8-bit wide bus operation but D4-D7 are not configured).
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*/
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stm32_configgpio(GPIO_SDIO_D0);
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stm32_configgpio(GPIO_SDIO_D1);
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stm32_configgpio(GPIO_SDIO_D2);
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stm32_configgpio(GPIO_SDIO_D3);
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stm32_configgpio(GPIO_SDIO_CK);
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stm32_configgpio(GPIO_SDIO_CMD);
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/* Put SDIO registers in their default, reset state */
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stm32_default();
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return -ENOSYS;
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}
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#endif /* CONFIG_STM32_SDIO */
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