arch/arm/src/stm32 and stm32l4: In 1wire driver, do not write useless WRITEBIT zero return value to const buffer
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a71aa070e7
commit
af5bcc0c13
@ -981,15 +981,12 @@ static int stm32_1wire_isr(int irq, void *context, void *arg)
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stm32_1wire_send(priv, READ_TX);
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stm32_1wire_send(priv, READ_TX);
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break;
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break;
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case ONEWIRETASK_WRITEBIT:
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*priv->byte = 0;
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priv->msgs = NULL;
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priv->result = OK;
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nxsem_post(&priv->sem_isr);
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break;
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case ONEWIRETASK_READBIT:
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case ONEWIRETASK_READBIT:
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*priv->byte = (dr == READ_RX1) ? 1 : 0;
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*priv->byte = (dr == READ_RX1) ? 1 : 0;
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/* Fall through */
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case ONEWIRETASK_WRITEBIT:
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priv->msgs = NULL;
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priv->msgs = NULL;
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priv->result = OK;
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priv->result = OK;
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nxsem_post(&priv->sem_isr);
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nxsem_post(&priv->sem_isr);
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@ -906,15 +906,12 @@ static int stm32_1wire_isr(int irq, void *context, void *arg)
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stm32_1wire_send(priv, READ_TX);
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stm32_1wire_send(priv, READ_TX);
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break;
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break;
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case ONEWIRETASK_WRITEBIT:
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*priv->byte = 0;
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priv->msgs = NULL;
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priv->result = OK;
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nxsem_post(&priv->sem_isr);
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break;
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case ONEWIRETASK_READBIT:
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case ONEWIRETASK_READBIT:
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*priv->byte = (dr == READ_RX1) ? 1 : 0;
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*priv->byte = (dr == READ_RX1) ? 1 : 0;
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/* Fall through */
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case ONEWIRETASK_WRITEBIT:
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priv->msgs = NULL;
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priv->msgs = NULL;
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priv->result = OK;
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priv->result = OK;
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nxsem_post(&priv->sem_isr);
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nxsem_post(&priv->sem_isr);
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